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1. Altera FPGA 控制三速以太网IP核(TSE)问题

1、Altera FPGA 控制三速以太网IP核(TSE)问题

你可以通过生成的IP的testbench仿真中看到waitrequest信号的波形。要在MAC寄存器中的0x2地址中把收发数据使能打开。具体看官方文档中的寄存器说明。

它提供的以太网IP核记得是MAC层的IP核和三速以太网IP核，通常应用层需要自己写或者购买第三方IP，物理层需要外围芯片实现或者使用FPGA本身的硬件实现（如使用cyclone IV器件实现 1000BASE-X，但无法实现1000BASE-T）。

一般的ip核都有自动生成工具，比如Altera有megacore wizard，按照你需要的功能enable或者disable选项就可以了。具体步骤可以上Altera或者Xilinx的网站，搜索你需要的以太网ip核关键字，比如GE或者FE，以及是否需要MAC，PCS功能等。

有现成的IP核，生成IP核的过程中，有一个datasheet的按钮。进去看看，就知道了。

去知网上搜，非常多的文章，基于FPGA的XXXX，总会有很多启示的。基于IP核，无非就是将官方的IP核进行例化，参数要设置正确，将连接电路处理好。不难的。

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